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什么是同步邏輯和異步邏輯,同步電路和異步電路的區(qū)別是什么?
同步邏輯是時鐘之間有固定的因果關(guān)系。異步邏輯是各時鐘之間沒有固定的因果關(guān)系。
步進電機電路設(shè)計可分類為同步電路和異步電路設(shè)計。
同步電路利用時鐘脈沖使其子系統(tǒng)同步運作,而異步電路不使用時鐘脈沖做同步,其子系統(tǒng)是使用特殊的“開始”和“完成”信號使之同步。由于異步電路具有下列優(yōu)點--無時鐘歪斜問題、低電源消耗、平均效能而非最差效能、模塊性、可組合和可復(fù)用性--因此近年來對異步電路研究增加快速,論文發(fā)表數(shù)以倍增,而Inb Pentium 4處理器設(shè)計,也開始采用異步電路設(shè)計。
異步電路主要是組合邏輯電路,用于產(chǎn)生地址譯碼器、FIFO或RAM的讀寫控制信號脈沖,其邏輯輸出與任何時鐘信號都沒有關(guān)系,譯碼輸出產(chǎn)生的毛刺通常是可以監(jiān)控的。同步電路是由時序電路(寄存器和各種觸發(fā)器)和組合邏輯電路構(gòu)成的電路,其所有操作都是在嚴(yán)格的時鐘控制下完成的。這些時序電路共享同一個時鐘CLK,而所有的狀態(tài)變化都是在時鐘的上升沿(或下降沿)完成的。
步進電機異步電路重要是組合邏輯電路,用于產(chǎn)生天址譯碼器、FIFO或RAM的讀寫節(jié)制信號脈沖,但它同時也用在時序電路中,彼時它出有統(tǒng)一的時鐘,狀態(tài)變化的時辰是不穩(wěn)定的,通常輸入信號只在電路處于波動狀態(tài)時才發(fā)作變化。也就是說一個時辰容許一個輸入產(chǎn)生變化,以防止輸入信號之間形成的競讓冒險。電路的穩(wěn)定需求有可靠的建立時間和持時間,待上面引見。
步進電機同步電路是由時序電路(寄存器和各種觸發(fā)器)和組合邏輯電路形成的電路,其一切操作都是在嚴(yán)厲的時鐘掌握下完成的。這些時序電路同享統(tǒng)一個時鐘CLK,而一切的狀態(tài)變化都是在時鐘的上升沿(或降落沿)完成的。比如D觸發(fā)器,當(dāng)上升延到來時,寄存器把D端的電平傳到Q輸出端。
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